RTLを語る会(16)あいさつ

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1. RTLを語る会(16) ～Vitis友の会～ #talkrtl
2. RTLを語る会とは • 年に1回程度人が集まってできればいいなと思 うゆるふわな交流会 • 内容はVHDL/Veirlog HDL/SystemVerilog/HLS/ASIC/FPGA 等 • 第9回(2015/06/27)からこのスタイル • それまでは飲み会でした
3. RTLを語る会、今回の内 容とその背景 • RTLをグダッて語る会(2019/09/21) • https://twipla.jp/events/402721 • 参加した人から快諾()をいただいた
4. 今回の発表 キーワード FPGA Real Number Modeling RISC-V Rust HLS SystemVerilog
5. 発表者の方々、もしよろしければ... •こちらに資料を投稿して下さい！ • https://talkrtl.connpass.com/event/149523/presentation/
6. 最後に •今日はスペースをお貸しいただいた •コワーキングスペース茅場町さん •誠にありがとうございました！ •参加していただいた皆さん •また来て下さいね。
7. ついでに
8. 自己紹介 • @tethys_seesaa • 「てて」とか「ててす」とか呼ばています。 • 40代のエンジニア。 • AI関係のサービス会社に勤めています • ハードウェア担当 • 久しぶりにSystemVerilog UVMと格闘する日々 • プライベート( ) • 今のところ世に出せる成果物なし…
9. ねこ(♂11歳)
10. ねこ(♀10歳)